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边沿触发器逻辑功能 — 机械工程选择题

电工电子技术 时序逻辑电路 AI 三重审校通过

题目
某负边沿触发的 JK 触发器,初始状态 Q=0。在每个时钟脉冲下降沿时刻,输入 J、K 依次为:第1个下降沿 J=1,K=0;第2个下降沿 J=0,K=0;第3个下降沿 J=0,K=1;第4个下降沿 J=1,K=1。问第4个下降沿过后触发器的输出状态 Q 为:A. 0 B. 1 C. 不确定 D. 保持初态0